2013년08월18일 74번
[전기제어공학] 그림과 같은 계전기 접점회로의 논리식은?
-
①
-
②
-
③
-
④
(정답률: 80%)
문제 해설
계전기는 입력 전압이 인가되면 접점을 닫거나 열어 전기회로를 연결하거나 차단하는 장치입니다. 이러한 계전기의 동작 원리를 이용하여 논리회로를 구성한 것입니다.
논리식을 살펴보면, 입력 A와 B가 모두 참일 때 계전기가 동작하여 출력 Y가 참이 됩니다. 이는 AND 게이트의 논리식과 동일합니다. 따라서 정답은 ""입니다.
그 외의 보기들은 입력 A와 B 중 하나가 참일 때 출력 Y가 참이 되는 OR 게이트, 입력 A와 B가 모두 거짓일 때 출력 Y가 참이 되는 NOT 게이트, 입력 A와 B가 모두 참일 때 출력 Y가 거짓이 되는 NAND 게이트를 나타냅니다.
논리식을 살펴보면, 입력 A와 B가 모두 참일 때 계전기가 동작하여 출력 Y가 참이 됩니다. 이는 AND 게이트의 논리식과 동일합니다. 따라서 정답은 "
"입니다. 그 외의 보기들은 입력 A와 B 중 하나가 참일 때 출력 Y가 참이 되는 OR 게이트, 입력 A와 B가 모두 거짓일 때 출력 Y가 참이 되는 NOT 게이트, 입력 A와 B가 모두 참일 때 출력 Y가 거짓이 되는 NAND 게이트를 나타냅니다.
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